可配置eSi-RISC处理器核心BaySand晶片的客户

EnSilica、半导体解决方案的提供者和IP与BaySand,专家在应用程序配置ASIC BaySand向客户提供的新推出的ASIC ultrashuttle - 65多项目晶片(”)客户提供一系列IP解决方案,可以配置为特定的应用程序需求。

IPs将包括EnSilica eSi-RISC的处理器核心,eSi-Connect处理器外设,eSi-Crypto加密和eSi-Comms通信IP解决方案以及硬件加速器。

EnSilica的自动流允许复杂的CPU子系统在几天内交付给客户。这个子系统可以包含单个或多个eSi-RISC处理器核心和JTAG调试和一系列外围设备、计时器以及加密加速器核心,使安全引导和沟通。系统是建立在标准多层AMBA AHB总线结构生成的自动化流程。额外的APB、AHB上可以包括允许客户的轻松集成的IP核。这个设计流程允许EnSilica处理器子系统是交付给客户之前,第一个ASIC ultrashuttle 65年10月- 65”运行。

“我们非常高兴成为一个活跃的和不可或缺的伙伴在其新的ASIC BaySand ultrashuttle - 65”计划,“说伊恩•Lankshear EnSilica的首席执行官。“通过支持多个项目定制四个金属层和促进进入深亚微米硅通过提供一个负担得起的和可靠的ASIC的解决方案,ASIC ultrashuttle - 65航天飞机计划重新定义了传统的硅其他铸造厂提供的概念。”

的支持下一个经过验证的设计流程和方法,不需要任何特殊的EDA工具,专业知识或许可证,ASIC ultrashuttle - 65”程序结构化,提供高质量、验证和充分测试ASIC。方法是基于BaySand完全标准单元库的特征,加上EnSilica eSi-family硅验证的IP和结合BaySand RTL签收可测试性设计方法,包括设计(DFT),自动测试模式生成(生成),全扫描,JTAG、阿拉伯学者和物理实现。ASIC ultrashuttle - 65”也可以用于FPGA ASIC转换最小化风险,降低成本和缩短上市时间。

EnSilica eSi-RISC是家庭的高度可配置和低功耗嵌入式系统软处理器核心,规模在范围广泛的应用程序和独特的同时支持16位和32位配置。硅芯被广泛证实的各种ASIC技术到28 nm。EnSilica eSi-RISC家庭是完全支持的范围的IP库包括eSi-Connect处理器外设,eSi-Crypto加密硬件加速器和eSi-Comms通信解决方案。

“我们非常兴奋EnSilica支持我们的行动之间的桥梁ASIC设计人员和65海里ASIC实现,“说埃胡德•Yuhjtman BaySand执行市场营销和销售。“EnSilica参与ASIC ultrashuttle - 65项目,我们共同的客户现在有机会实现SoC的全套先进的IPs包括基于risc CPU、加密和硬件加速器”。

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